CN101595701B - 差分对作为单端数据路径以传输低速数据之运用 - Google Patents

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Abstract

本文提供用以跨接线对发送信号的系统及方法。根据特定实施例，在一时段期间跨该接线对发送差分信号，并且在另一时段期间跨相同接线对发送两单端信号。可利用低电压差分信令(LVDS)跨该接线对发送该差分信号。相对地，可利用非差分信令跨该相同接线对发送该等两单端信号。

Description

差分对作为单端数据路径以传输低速数据之运用
本申请要求2006年11月17日提交的Naresh B.Shetty的美国专利申请No.11/601,070的优先权。
技术领域
本发明的实施例涉及高速及低速串行数据信号两者的传输及接收。本发明的实施例还涉及差分及单端信号两者的传输及接收。
背景技术
今日，诸如视频信号之类的高速信号通常是利用数个单端信号路径连同时钟源从源(如主机处理器)发送至接收器(如显示器驱动器)。然而，随着数据速率提高，传统的互补对称金属氧化物半导体/晶体管晶体管逻辑(CMOS/TTL)信令易于产生电磁干扰(EMI)相关问题。此外，当从源至接收器的数据量增加时(如随着显示器的分辨率提高)，从源至接收器的信号数量也增多，其导致将更快速且更宽广的信号从源发送至接收器而增加功率消耗。这并非所乐见，特别是在便携设备中。因此，需要减少因将高速信号从源发送至接收器而所导致功率消耗。
发明内容
本发明的实施例涉及用以跨接线对发送信号的系统及方法。根据特定实施例，在一时段期间中跨该接线对发送差分信号，并且在另一时段期间中跨相同接线对发送两个单端信号。可利用低电压差分信令(LVDS)以跨该接线对发送该差分信号。相反，可利用非差分信令以跨该相同接线对发送这两个单端信号。该接线对可为如双绞线或导电迹线对，但不限于此。
本发明的实施例可用以如降低具有主动模式以及睡眠模式或待机模式的移动设备内的功率消耗。根据特定实施例，当设备在主动模式时执行该LVDS，并且当该设备在睡眠或待机模式时使用非差分信令。换言之，当该设备在第一模式(如主动模式)时，可利用该接线对作为单一差分对，并且当该设备在第二模式(如睡眠或待机模式)时，可利用该相同接线对作为两条单独的串行线路(如I2C类型SDA及SCL线路)。
根据本发明之特定实施例，系统包含发送器，其具有输出对；以及接收器，其具有输入对。该发送器的输出对被配置成通过接线对而连接至该接收器的输入对。当在第一模式(如主动模式)时，该发送器在两个输出处输出差分信号，以跨该两条接线发送至该接收器的两个输入。相反，当该发送器在第二模式(如睡眠或待机模式)时，该发送器输出两个单端信号，两个输出处各一，以跨相同的两条接线发送至该接收器的两个输入。
根据特定实施例，该接收器也可处于第一模式及第二模式。当该接收器在该第一模式时，该接收器可将其两个输入处所收到的信号当作差分信号；而当该接收器在第二模式时，接收器可将其两个输入处所收到的信号当作单端信号。
根据特定实施例，发送器及接收器各自包含开关对，其用以指定I2C信号跨该接线对作为差分信号的嵌入部分发送还是跨相同接线对作为两个单独单端信号发送。
以下阐述的详细说明、附图及权利要求将使本发明的进一步实施例、特征、方面与优势变得显而易见。
附图简述
图1是高级框图，其可用于解释用以在发送器与接收器之间发送高速及低速信号的一个方案。
图2是高级框图，其可用于解释用以在发送器与接收器之间发送高速及低速信号的替代性方案。图2方案相较于图1方案提供较低功率消耗，但在发送器与接收器之间需要较多的接线。
图3是高级框图，其可用于解释本发明实施例，其可用以减少功耗而无须增加发送器与接收器之间的接线数量。
图4及5是可用于概括本发明的特定实施例的高级流程图。
图6是高级框图，其说明图3的发送器及接收器可如何地成为收发器的部分。
实施方式
各种信号需从源发送至接收器，如在当源是主机处理器而接收器是显示器驱动器时。此等信号可包含RGB信号、水平及垂直同步信号(HSYNC及VSYNC)、处理器时钟信号(PCLKIN)、数据启动信号(DATAEN)及重置/断电信号(RESET/PWRDN)。同时，还可需要发送额外的低速控制信号，像是集成电路间电路(I2C)信号。此者之范例显示于图1，如后所述。
图1示出发送器112及接收器132，其用以将视频信号自主机处理器102(又简称为主机)发送至显示器驱动器152。该显示器驱动器152可包含行及列驱动器，其驱动显示器(未图示)，诸如移动电话、相机或其他移动设备的液晶显示器(LCD)。
该发送器112被显示为包含输入闩114、串行器116、输出级118以及时序、控制与锁相回路(PLL)块120。该接收器132被显示为包含输入级138、解串行器136、输出闩134以及时钟与数据复原(CDR)及控制块140。
该主机被显示为将RGB、RESET/PWRDN、HSYNC、VSYNC、DATAEN及PCLKIN信号提供至该发送器112，因此该发送器112可将此等信号或是其他表示该等信号的信号发送至该接收器132。此外，较低速度的I2C信号，包含串行时钟(SCL)及串行数据(SDA)信号被提供至该发送器112，用于发送至该接收器132。该SCL及SDA信号被显示为由微控制器104所产生，其与该主机102通讯，但可由该主机102或一些其他的元件所产生作为替代。进一步的微控制器1 54被显示为接收SCL及SDA信号，可将此等信号提供至该显示器驱动器152或一些其他的元件作为替代。
接线对130将发送器112的输出级118连接至该接收器132的输入级138。该串行器116及该输出级118，连同该输入级138及该解串行器136，使得运用以低电压差分信令(LVDS)为基础的串行化及解串行化(SERDES)方案能够以避免EMI问题的快速且高功率效率的方式跨该接线对130上发送数据。此外，CDR电路140用以消除在个别接线上发送个别时钟信号的需要。
该串行器116将经由该输入闩114所收到的平行RGB位转换成串行信号。此外，该串行器116将RESET/PWRDN、HSYNC、VSYNC、DATAEN及PCLKIN信号，或代表该等的信号，嵌入至该串行信号。同样地，在图1所示的实施例里，该串行器116亦将SCL及SDA信号，或代表该等之信号，嵌入至该串行信号。该串行器利用时间复用方案将各种信号嵌入至该串行信号。
为提供低功率及高速通讯，利用低电压差分信令(LVDS)将串行数据信号从发送器112发送至该接收器132。为达此，该输出级118可按众知方式，将由该串行器116所输出的单端串行数据信号转换成具有低电压摆动的差分信号。除提供低功率及高速通信以外，此传输方案提供良好的共模抑制及抗扰度。由于其操作，该输出级118亦可称为LVDS发送器118。LVDS提供按GHz范围，或至少为MHz范围的传输。相对地，I2C提供按100-400 KHz之范围的传输。
高速差分信号跨该接线对130从该发送器112发送至该接收器132。此等接线130可为双绞线，然非必要。此外，由于在此所使用的术语“接线”指的是导电信号路径，该接线对130可为导电迹线对。
该输入级138将跨该接线对130所接收的LVDS差分信号转换成单端串行数字信号。由于其操作，输入级138又可称为LVDS接收器。该解串行器136自该输入级138的输出接收该单端串行信号，并且将平行RGB位提供至该输出闩134。该解串行器136又将RESET/PWRDN、HSYNC、VSYNC、DATAEN及PCLKIN信号，或代表该等之信号，提供至CDR与控制块140。该CDR与控制块140复原该(等)时钟信号，并且将RESET/PWRDN、HSYNC、VSYNC、DATAEN及PCLKIN信号提供至该显示器驱动器1 52。此外，在本实施例里，该解串行器136解嵌入SCL及SDA信号，或代表该等的信号，且CDR与控制块140将该等信号提供至该微控制器154，或是提供至该显示器驱动器152或一些其他的元件。该解串行器136利用时间分用以区分出由该串行器116合并成串行信号的所有各种信号。
假设图1所示之元件在诸如移动电话或相机之类的移动设备内，该设备可能在大部分(如80％)的时间是在睡眠模式或待机模式，以保留该设备的电池寿命。当于睡眠或待机模式时，最好是有尽可能多的元件是非主动，因此其不汲取功率。例如，当该发送器112在睡眠或待机模式时，可希望所有牵涉到高速通信的元件为非主动，包含输入闩114、串行器116、LVDS发送器118以及时序、控制与PLL块120(在图式中皆按粗线所示)。然而，即使是在睡眠模式期间，亦经常有需要将诸如I2C信号(SCL及SDA)的低速数据信号如从微控制器104发送至该微控制器154。为此理由，图1之实施例并非高功率效率，因为至少仍需对该发送器的时序、控制与PLL块120、串行器116、输出级118、以及接收器的输入级138、解串行器136和CDR与控制块140供电，让低速(如SCL及SDA)线路能够被发送。这可导致按25MHz运行电路来发送100KHz控制信号，其非有效率方案。
如图2所示，一种避免前述功率无效率问题的方式为在发送器112与接收器132之间提供两条额外接线230，而额外接线230专属于发送低速(如I2C)信号。然而，此非优选，因为希望不增加元件间之接线的数量。如后文中关于图3所述，本发明之实施例提供不增加该发送器112与该接收器132间之接线的数量的较有说服力的解决方式。
参照图3，开关对326添加于该发送器112内，并且开关对346添加于该接收器132内，后文中将说明原因。替代地而非较佳地，此开关326及346可位在发送器112及接收器132的外部。根据实施例，该等开关326及346为利用晶体管所实现的模拟开关。
根据实施例，当有需要在该发送器112与该接收器132间发送高速信号时，如当主机正将如嵌入LVDS信号的高速RGB、RESET/PWRDN、HSYNC、VSYNC、DATAEN及PCLKIN信号提供至该发送器112时，该等开关326及346为打开(即断)。当该等开关326及346为打开(即断)时，低速控制信号(如SCL及SDA)亦由该发送器112嵌入至跨该接线对130上所发送的LVDS信号，并且该接收器132可按前文关于图1所述相同的方式将此等低速控制信号解嵌入。然而，当不需要在该发送器112与该接收器132之间发送高速信号时，如当该主机并未将RGB、RESET/PWRDN、HSYNC、VSYNC、DATAEN及PCLKIN信号提供至发送器112时，该等开关326及346为关闭(即通)。此外，当不需要在该发送器112与该接收器132之间发送高速信号时，可将该发送器112及该接收器132设置在睡眠或待机模式，允许所有(或至少一些)牵涉到高速通讯的元件(按粗线所绘)为非主动。在该发送器112里，可在睡眠或待机模式期间为非主动(并因此通常仅耗用晶体管漏泄功率)的元件包含该输入闩114、该串行器116、该输出级118及该时序、控制与PLL区块120。该主机亦可为非主动，或至少在较低功率模式。在该接收器132里，可在睡眠或待机模式期间为非主动的元件包含输入级138、解串行器136、输出闩134及该CDR与控制块140。
可利用在该发送器112内的模式控制器322以及在该接收器132内之模式控制器342检测何时该发送器112及该接收器132在睡眠或待机模式为适当，如相反于主动模式。由于通常在此所使用的术语“睡眠”及“待机”用以识别省电模式，其中某些元件系完全或至少部份地为非主动。然而，应注意到亦有可能有一个以上的可选择省电模式，如其中一模式较另一者节省更多的功率。
有多种方式让该模式控制器322及342可决定何时令该发送器112及该接收器132进入睡眠或待机模式，或更广义地说，进入降低功率模式。例如，模式控制器322可监视该PCLKIN信号，并且该模式控制器342可监视该PCLKOUT信号，如图3所示。按此方式，当该模式控制器322并未检测到该PCLKIN信号时(如对于至少指定时段)，该模式控制器322可令该发送器112进入睡眠或待机模式。同样地，当该模式控制器342并未检测到该PCLKOUT信号时(如对于至少一指定时段)，该模式控制器342可令该接收器132进入睡眠或待机模式。也可能是监视替代信号——诸如DATAEN信号，以决定何时在睡眠或待机模式与主动模式之间切换。换言之，该等模式控制器322及342可监视出现或没有信号，以知晓何时该发送器112及该接收器132应在睡眠/待机模式或主动模式。
如图3所示，该模式控制器322亦可用以控制该开关326，并且该模式控制器342亦可用以控制该开关346。更详细地说，根据本发明之实施例，该模式控制器322在当模式控制器322令该发送器112进入睡眠或待机模式时关闭(即通)该开关对326，并且在当模式控制器322令该发送器112返回到主动模式时开启(亦断)该开关对326。同样地，模式控制器342在当模式控制器342令该接收器132进入睡眠或待机模式时关闭(即通)该开关对346，并且在当该模式控制器342令该接收器132返回到主动模式时打开(即断)该开关对346。该模式控制器322及342可为简单状态机或类似者，如本领域的一般技术人员将察知。
当该等开关326及346为关闭(即通)时，当该发送器112及该接收器132在主动模式时经由用于高速低电压差分信令(LVDS)的相同接线对130，将低速信号(如SCL及SDA)自该发送器112发送至该接收器132。然而，当该接线对130用于高速LVDS(并且该等开关326及346为打开)时，利用该接线对作为差分对。相反，当开关326及346为关闭(即通)时，该接线对130用以发送低速信号，而该接线对用作两个单独单端串行线路，如一者发送SCL信号，而另一者发送SDA信号。
如图3所示，提供缓冲器124及144以启动低速数据的双向性、阻抗匹配及电路隔离。
图4高级流程图可用于概括本发明的特定实施例，其可用以如降低具有第一模式(如主动模式)及第二模式(如睡眠或待机模式)的移动设备的功率消耗。参照图4，在步骤402，当该设备在该第一模式(如主动模式)时，利用低电压差分信令(LVDS)跨接线对(如130)发送第一类型信息(如高速数据及时钟)及第二类型信息(如低速I2C数据及时钟)两者。相反，如步骤404所示，当该设备在第二模式(如睡眠或待机模式)时，利用非差分信令跨相同接线对(如130)发送该第二类型信息(如低速I2C数据及时钟)，而非第一类型信息(如高速数据及时钟)。
根据该特定实施例，在步骤402，当该设备在该第一模式(如主动模式)时，利用该接线对(如130)作为单一差分对。而相对地，在步骤404，当该设备在该第二模式(如睡眠或待机模式)时，该接线对(如130)是用来作为两个单独的单端串行线路。
图5是高级流程图，其亦概括本发明之特定实施例。如图5所示，在步骤502，在时段期间跨接线对发送差分信号；并且在步骤504，在另一时段期间跨相同接线对发送两单端信号。如前述，可利用低电压差分信令(LVDS)跨该接线对发送该差分信号；并且可跨相同接线对利用非差分信令发送该两单端信号。如前述，该接线对可为双绞线或导电迹线对，然不限于此。在特定实施例里，可在当设备在主动模式时执行步骤502；并且可在当设备在睡眠或待机模式时执行步骤504。
在图3里，该发送器112被显示为与将视频及控制信号发送至接收器132的主机处理器102相关联，而此接收器被显示为与显示器驱动器152相关联。然此环境仅为可运用本发明之实施例的一示范性环境。本领中普通的技术人员将自前述说明而了解本发明实施例可运用于其他希望将接线对运用于高速差分信令及低速单端信令两者的环境。而在两种类型之信令间切换的原因可如前述般降低功率消耗。然可有其他可希望的理由。
在图3里，该发送器112被显示为与该接收器132通讯。虽未在图3特定绘示，然该发送器112可为收发器的部份。同样地，该接收器132可为另一收发器的部份。其范例如图6中所示。虽未绘示，然该收发器612将可能亦包含类似于块140的CDR与控制块；而该收发器632将可能亦包含类似于块120的发送时序、控制与PLL块。并且，虽未在图6中特定绘示，然该等许多信号可为双向性，其中使用到收发器。在所示实施例里，该等收发器提供SCL及SDA信号的半双工通讯。
各生发器包含能够进行全双工操作的串行器/解串行器(SerDes)也是可能的，意思是可同时地在两个方向上进行数据转换。在此实施例里，各收发器不需要包含单独的串行器及解串行器。
上述说明为本发明之较佳实施例。该等实施例已提供说明及描述之目的，然非意图为彻底的或将本发明限制于所揭示的精确形式。熟谙本领域的技术人员将显知众多修改及变化。该等实施例经选定且描述以最佳地说明本发明原理及其实际应用，藉此让其他熟谙本领域的技术人员能够了解本发明。本发明范畴欲由所附权利要求及其等价物定义。

Claims (21)

1.一种用以跨接线对发送信号的方法，其中包含：
(a)在当设备处于主动模式时的时段期间跨所述接线对发送差分信号，跨所述接线对发送的差分信号包括高速视频信号，并且跨所述接线对发送的差分信号还包括嵌入所述高速视频信号的低速串行时钟信号SCL和低速串行数据信号SDA；以及
(b)在当所述设备处于睡眠或待机模式时的另一时段期间跨相同接线对发送两单端信号，所述两单端信号均不包括所述高速视频信号，跨所述接线中的一个所发送的所述两单端信号中的一个包括所述低速串行时钟信号SCL，并且跨所述接线中的另一个所发送的所述两单端信号中的另一个包括所述低速串行数据信号SDA。
2.如权利要求1所述的方法，其特征在于：
步骤(a)包含利用低电压差分信令LVDS以跨所述接线对发送所述差分信号；以及
步骤(b)包含利用非差分信令以跨所述相同接线对发送所述两单端信号。
3.如权利要求1所述的方法，其特征在于，所述接线对包含双绞线。
4.如权利要求1所述的方法，其特征在于，所述接线对包含导电迹线对。
5.如权利要求1所述的方法，其特征在于，所述睡眠或待机模式相较于所述主动模式是降低功率模式。
6.一种用以降低具第一模式以及第二模式的电池供电移动设备的功率消耗的方法，所述方法包含：
(a)当所述设备在所述第一模式时，利用低电压差分信令(LVDS)跨接线对发送高速视频信号以及嵌入所述高速视频信号的低速串行时钟信号SCL和低速串行数据信号SDA；以及
(b)当所述设备在所述第二模式时，利用非差分信令跨所述接线对发送所述串行时钟信号SCL和所述低速串行数据信号SDA，而非所述高速视频信号；
其中，当所述设备在所述第二模式时，利用非差分信令跨所述接线对中的一个发送所述低速串行时钟信号SCL，并且利用非差分信令跨所述接线对中的另一个发送所述低速串行数据信号SDA。
7.如权利要求6所述的方法，其特征在于：
步骤(a)包含当所述设备在所述第一模式时，利用所述接线对作为单一差分对；以及
步骤(b)包含当所述设备在所述第二模式时，利用所述接线对作为两单独串行线路。
8.如权利要求6所述的方法，其特征在于：
所述第一模式是主动模式；以及
所述第二模式是睡眠或待机模式。
9.如权利要求6所述的方法，其特征在于，所述第二模式相较于所述第一模式是降低功率模式。
10.如权利要求6所述的方法，其特征在于：
所述高速视频信号按第一速度来发送，所述第一速度至少为MHz范围，或为GHz范围；以及
所述低速串行时钟信号SCL和低速串行数据信号SDA按比所述第一速度更低的速度来发送，所述更低的速度在100到400KHz的范围内。
11.一种用以跨接线对发送信号的系统，包含：
发送器，被配置成发送高速视频信号以及低速串行时钟信号SCL和低速串行数据信号SDA，所述发送器包含输出对；以及
接收器，其包含输入对；
其中所述发送器的输出对被配置成通过接线对连接至所述接收器的输入对；
其中当在第一模式时，所述发送器在两输出处输出差分信号，以跨所述接线对发送至所述接收器的两输入，所述差分信号包括所述高速视频信号和嵌入所述高速视频信号的所述低速串行时钟信号SCL和低速串行数据信号SDA；以及
其中当在第二模式时，所述发送器输出两单端信号，两输出各一，以跨相同的两接线发送至所述接收器的两输入，所述两单端信号中的一个包括所述低速串行时钟信号SCL，所述两单端信号中的另一个包括所述低速串行数据信号SDA。
12.如权利要求11所述的系统，其特征在于：
在任何时候，所述接收器亦可处于所述第一模式及所述第二模式；
当所述接收器在所述第一模式时，所述接收器将在其两个输入处所收到的信号当作差分信号；以及
当所述接收器在所述第二模式时，所述接收器将在其两个输入处所收到的信号当作两单端信号。
13.如权利要求11所述的系统，其特征在于：
所述第一模式是主动模式；以及
所述第二模式是睡眠或待机模式。
14.如权利要求11所述的系统，其特征在于，所述第二模式相较于所述第一模式是降低功率模式。
15.如权利要求11所述的系统，其特征在于，所述发送器包含开关对，其使所述低速串行时钟信号SCL和低速串行数据信号SDA跨所述接线对被发送为所述差分信号的嵌入部分，或者是跨相同接线对发送为两个单独的单端信号。
16.如权利要求11所述的系统，其中：
所述发送器包含串行器及输出级，其根据所述串行器之输出产生差分信号；以及
所述接收器包含输入级，其根据在所述接收器之两输入处所收到的差分信号以产生单端信号，以及解串行器，其接收所述输入级之输出。
17.一种用以跨接线对发送信号的系统，其中包含：
在当所述系统处于主动模式时的时段期间跨所述接线对发送差分信号的装置，所述差分信号包括高速视频信号以及嵌入所述高速视频信号的低速串行时钟信号SCL和低速串行数据信号SDA；以及
在当所述系统处于睡眠或待机模式时的另一时段期间跨所述接线对发送两单端信号的装置，所述两单端信号均不包括所述高速视频信号，所述两单端信号中的一个包括所述低速串行时钟信号SCL，并且所述两单端信号中的另一个包括所述低速串行数据信号SDA。
18.如权利要求1所述的方法，其特征在于，还包括：
当所述设备处于睡眠或待机模式时，使跨所述接线对发送差分信号的至少某些电路变为非主动，从而降低功率消耗。
19.如权利要求6所述的方法，其特征在于，还包括：
当使用非差分信令时，使用于低电压差分信令LVDS的至少某些电路变为非主动，从而降低功率消耗。
20.如权利要求11所述的系统，其特征在于：
所述发送器是所述系统的第一收发器的一部分；以及
所述接收器是所述系统的第二收发器的一部分。
21.如权利要求11所述的系统，其特征在于，在所述系统处于睡眠或待机模式时，使用于跨所述接线对发送差分信号的至少某些电路变为非主动，从而降低功率消耗。
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