DE2355605B2 - Verfahren zum stabilisieren der schwellenspannung von silizium-gate- feldeffekttransistoren mit aus oxyd/ nitrid-isolierschichten zusammengesetzten gate-dielektrika - Google Patents
Verfahren zum stabilisieren der schwellenspannung von silizium-gate- feldeffekttransistoren mit aus oxyd/ nitrid-isolierschichten zusammengesetzten gate-dielektrikaInfo
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- 229910052710 silicon Inorganic materials 0.000 title claims description 20
- 239000010703 silicon Substances 0.000 title claims description 19
- 150000004767 nitrides Chemical class 0.000 title claims description 18
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 title claims description 17
- 238000000034 method Methods 0.000 title claims description 17
- 230000005669 field effect Effects 0.000 title claims description 15
- 239000003989 dielectric material Substances 0.000 title claims description 6
- 230000000087 stabilizing effect Effects 0.000 title claims description 3
- 239000002131 composite material Substances 0.000 title description 2
- 238000009413 insulation Methods 0.000 title description 2
- 238000010438 heat treatment Methods 0.000 claims description 27
- 239000003990 capacitor Substances 0.000 claims description 20
- 229910052760 oxygen Inorganic materials 0.000 claims description 19
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 claims description 18
- 239000001301 oxygen Substances 0.000 claims description 18
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 claims description 14
- 229910052581 Si3N4 Inorganic materials 0.000 claims description 12
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 claims description 12
- 239000000758 substrate Substances 0.000 claims description 7
- 239000004065 semiconductor Substances 0.000 claims description 4
- 229910052814 silicon oxide Inorganic materials 0.000 claims description 2
- 238000004519 manufacturing process Methods 0.000 description 9
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 9
- 238000000151 deposition Methods 0.000 description 7
- 230000008021 deposition Effects 0.000 description 6
- 239000000377 silicon dioxide Substances 0.000 description 6
- 238000009792 diffusion process Methods 0.000 description 5
- 235000012239 silicon dioxide Nutrition 0.000 description 5
- ILAHWRKJUDSMFH-UHFFFAOYSA-N boron tribromide Chemical compound BrB(Br)Br ILAHWRKJUDSMFH-UHFFFAOYSA-N 0.000 description 4
- 230000006870 function Effects 0.000 description 4
- 239000007789 gas Substances 0.000 description 3
- 238000005259 measurement Methods 0.000 description 3
- 230000035882 stress Effects 0.000 description 3
- IJGRMHOSHXDMSA-UHFFFAOYSA-N Atomic nitrogen Chemical compound N#N IJGRMHOSHXDMSA-UHFFFAOYSA-N 0.000 description 2
- 229910015845 BBr3 Inorganic materials 0.000 description 2
- 238000009825 accumulation Methods 0.000 description 2
- 229910052782 aluminium Inorganic materials 0.000 description 2
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 2
- 239000012535 impurity Substances 0.000 description 2
- 239000000523 sample Substances 0.000 description 2
- 238000010792 warming Methods 0.000 description 2
- ZOXJGFHDIHLPTG-UHFFFAOYSA-N Boron Chemical compound [B] ZOXJGFHDIHLPTG-UHFFFAOYSA-N 0.000 description 1
- UFHFLCQGNIYNRP-UHFFFAOYSA-N Hydrogen Chemical compound [H][H] UFHFLCQGNIYNRP-UHFFFAOYSA-N 0.000 description 1
- OAICVXFJPJFONN-UHFFFAOYSA-N Phosphorus Chemical compound [P] OAICVXFJPJFONN-UHFFFAOYSA-N 0.000 description 1
- 229910004298 SiO 2 Inorganic materials 0.000 description 1
- 230000003321 amplification Effects 0.000 description 1
- 230000006399 behavior Effects 0.000 description 1
- 230000009286 beneficial effect Effects 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 229910052796 boron Inorganic materials 0.000 description 1
- 229910052799 carbon Inorganic materials 0.000 description 1
- 238000000576 coating method Methods 0.000 description 1
- 230000000295 complement effect Effects 0.000 description 1
- 239000004020 conductor Substances 0.000 description 1
- 238000010276 construction Methods 0.000 description 1
- 238000011109 contamination Methods 0.000 description 1
- 238000011161 development Methods 0.000 description 1
- 230000018109 developmental process Effects 0.000 description 1
- 238000006073 displacement reaction Methods 0.000 description 1
- 230000009429 distress Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 239000001257 hydrogen Substances 0.000 description 1
- 229910052739 hydrogen Inorganic materials 0.000 description 1
- 150000002500 ions Chemical class 0.000 description 1
- 230000007774 longterm Effects 0.000 description 1
- 229910052751 metal Inorganic materials 0.000 description 1
- 239000002184 metal Substances 0.000 description 1
- 239000000203 mixture Substances 0.000 description 1
- 229910052757 nitrogen Inorganic materials 0.000 description 1
- 238000003199 nucleic acid amplification method Methods 0.000 description 1
- 239000003921 oil Substances 0.000 description 1
- 230000003647 oxidation Effects 0.000 description 1
- 238000007254 oxidation reaction Methods 0.000 description 1
- 230000001590 oxidative effect Effects 0.000 description 1
- 238000009304 pastoral farming Methods 0.000 description 1
- 230000035515 penetration Effects 0.000 description 1
- 229910052698 phosphorus Inorganic materials 0.000 description 1
- 239000011574 phosphorus Substances 0.000 description 1
- 229920000515 polycarbonate Polymers 0.000 description 1
- 239000004417 polycarbonate Substances 0.000 description 1
- 230000001681 protective effect Effects 0.000 description 1
- 229910001415 sodium ion Inorganic materials 0.000 description 1
- 238000003860 storage Methods 0.000 description 1
- 239000000126 substance Substances 0.000 description 1
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
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- H01L21/02107—Forming insulating materials on a substrate
- H01L21/02296—Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer
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- H01L21/28—Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
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- H01L21/28167—Making the insulator on single crystalline silicon, e.g. using a liquid, i.e. chemical oxidation
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- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic System or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/28—Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
- H01L21/28008—Making conductor-insulator-semiconductor electrodes
- H01L21/28017—Making conductor-insulator-semiconductor electrodes the insulator being formed after the semiconductor body, the semiconductor being silicon
- H01L21/28158—Making the insulator
- H01L21/28167—Making the insulator on single crystalline silicon, e.g. using a liquid, i.e. chemical oxidation
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Description
Die Erfindung betrifft ein Verfahren zum Stabilisieren der Schwellenspannung von Silizium-Gate-Feldeffekttransistoren
mit aus Oxyd/Nitrid-Isolierschichten zusammengesetzten Gate-Dielektrika mittels einer Wärmebehandlung.
In den letzten Jahren gewannen Feldeffekttransistoren,
deren Gate-Dielektrikum aus einer Doppelschicht aus Siliziumdioxyd und Siliziumnitrid besteht, an
Bedeutung. Siliziumnitrid wird verwendet wegen seiner Spannungsfestigkeit und der Dielektrizitätskonstanten,
seiner Maskierfähigkeit gegen Diffusionen und Oxydationen und seiner Widerstandsfähigkeit gegen das
Eindringen positiv geladener Ionen. Diese sogenannten MNOS oder SNOS-IGFETs (Silicium-Nitride-Oxide-Silicium
insulated-Gate-FETs) bzw. damit im strukturellen Aufbau ähnliche Bauelemente, wie z. B. Kondensatoren,
zeigen jedoch Verschiebungen ihrer Schwellenspannung (Vr), wenn sie bei erhöhten Temperaturen mit
einer Gatespannung beaufschlagt werden.
Die Prüfung integrierter Schaltungen durch Spannungs- und Temperaturbelastung ist allgemein üblich
zur Bestimmung der langfristigen Leistungsfähigkeit und Zuverlässigkeit von Elementen. Dabei wurden in
vielen Typen von FETs, in denen das Gate-Dielektrikum aus Siliziumnitrid- und Siliziumdioxyd-Schichten besteht,
^Verschiebungen beobachtet. In dem Artikel »Charge Transport in ... (MNOS) Struktures«, Journal
of Applied Physics, Vol. 40, Nr. 8, July 1969, S. 3307ff., wird gezeigt, daß sich in diesen Elementen eine Ladung
in der Nähe der Trennfläche zwischen Nitrid und Oxyd ansammelt. Es wird angenommen, daß diese Ladung
sich bewegt, wenn eine Vorspannung an das Gati
angelegt wird und dadurch große Veränderungen in de: Schwellenspannung in den fertigen Elementen hervor
ruft Verunreinigungen durch Natriumionen tragei ebenfalls zur Ladungsansammlung an der Schnittstelh
bei
Es ist bekannt, daß sich Oberflächenzustände in Dielektrikum durch Erwärmen in einem Schutzgas be
erhöhter Temperatur entfernen lassen. Es lag somi
ίο nahe, das aus Nitrid und Oxyd zusammengesetzt!
Dielektrikum in Stickstoff oder Wasserstoff be erhöhter Temperatur zu erwärmen und so di<
Schwellenspannung der Nitrid/Oxyd-Dielektrika benut zenden Elemente zu stabilisieren. Dieses Verfahrei
bringt jedoch nicht den gewünschten Erfolg.
Aus der DT-OS 18 09 817 ist bekannt, den Silizium körper eines Feldeffekt-Transistors mit einer teilweisi
von Nitrid bedeckten Oxydhaut in trockener Sauerstoff atmosphäre bei einer Temperatur von 1000° C nachzu
behandeln. Damit sollen Oxydüberzüge mit hinsichtlicr
der Oxydladungen bzw. Oberflächenzustände unter schiedlichen Eigenschaften erreicht werden. Die von de
Erfindung betroffenen Süizium-Gate-Keldeffekuransi
stören sind dort nicht behandelt, örtlich unterschiedlich« Eigenschaften der Oxydschicht im kritischen Kanalbe
reich sind bei diesen Elementen auch nicnt angestrebt.
Die Aufgabe der Erfindung besteht in der Verbesse rung der Stabilität von Feldeffekttransistoren, di<
Silizium für das Gate und eine Doppelschicht au:
Siliziumdioxyd und Siliziumnitrid für das Gate-Dielek
trikum verwenden.
Zur Lösung dieser Aufgabe sieht die Erfindung die in Patentanspruch 1 bezeichneten Maßnahmen vor
Vorteilhafte Weiterbildungen der Erfindung sind in der Unteransprüchen gekennzeichnet. Durch das erfin
dungsgemäß ausgestaltete Verfahren lassen sich somi auch bei Silizium-Gate-Feldeffekttransistoren mil au:
Oxyd/Nitrid-Isolierschichten zusammengesetzter
Gate-Dielektrika hochstabile und reproduzierbare Schwellenspannungswerte erreicnen, was ein Häupter
fordernis für die produktionsmäßige Herstellung sol eher Bauelemente ist.
Ein Ausführungsbeispiel der Erfindung ist in der Zeichnungen dargestellt und wird anschließend nähei
beschrieben. Es zeigen
Fig. 1A bis 1D Schnittansichten eines Feldeffekttran
sistors,
Fig. 2 schematisch einen Feldeffekttransistor untei
Temperatur- und Spannungsbelastung,
Fig. 3 in einer Kurve die Veränderung der Schwel
lenspannung von Feldeffekttransistoren, die erwärm wurden, gegenüber solchen, die nicht erwärmt wurden,
F i g. 4 schematisch einen SNOS-Kondensator,
F i g. 5A und 5B in Kurven die Flachbandspannungs änderung, Δ Vfb in SNOS-Kondensatoren, die erwärm: wurden, gegenüber solchen, die nicht erwärmt wurden, F i g. 6A und 6B in Kurven Δ Vfb in SNOS-Kondensa toren, die in Sauerstoff bei verschiedenen Temperaturer behandelt wurden,
F i g. 5A und 5B in Kurven die Flachbandspannungs änderung, Δ Vfb in SNOS-Kondensatoren, die erwärm: wurden, gegenüber solchen, die nicht erwärmt wurden, F i g. 6A und 6B in Kurven Δ Vfb in SNOS-Kondensa toren, die in Sauerstoff bei verschiedenen Temperaturer behandelt wurden,
(.0 F i g. 7 und 8 Tabellen mit an erwärmten Elementer
gemessenen Werten.
Die Elemente werden erwärmt, nachdem die Schichten aus Siliziumoxyd und Siliziumnitrid auf eir
Siliziumsubstrat aufgebracht wurden und bevor da; Siliziumgate niedergeschlagen wird. Mit Ausnahme dei
Wärmebehandlung werden die Elemente nach detv bekannten Verfahren mit selbstregistrierendem Gate
hergestellt. Der Vollständigkeit halber soll aber die
Herstellung eines ganzen Elementes beschrieben werden.
Fig. IA zeigt ein Halbleitersubstrat 4 aus N-Silizium,
das in der 100-Ebene kristallographischer Ausrichtung
geschnitten ist und einen spezifischen Widerstand von etwa 2 Ohm - cm aufweist. In einer dicken Oxydschicht
6 ist ein Ausschnitt 5 über der Oberfläche des Substrates 4 ausgebildet Die Isolierschicht 6 besteht aus thermisch
aufgewachsenem Siliziumdioxyd und hat eine Dicke von 8000bisl5 000A.
In Fig. IB ist eine Oxydschicht 8 gezeigt, die als
Gateisolierung fungiert Die Schicht 8 ist etwa 300 Ä dick und aus Siliziumschicht 4 durch Erwärmung in
trockenem Sauerstoff auf 97O0C gebildet Die Dicke dieser Schicht soll vorzugsweise zwischen 200 und
900 Ä betragen. Eine Nitridschicht 10 wird dann auf der Schicht 8 niedergeschlagen. Die Schicht 10 ist
vorzugsweise 300 A dick und wird in einer Gasatmosphäre aus SiH4+ NH3 in einem Nj-Träger bei 8000C
gebildet. Die Dicke der Schicht 10 sollte zwischen 100
und 350 Ä betragen.
An diesem Punkt im Verfahren wird die Sauerstoff-Wärmebehandlung durchgeführt, wie nach der Erfindung
vorgesehen ist.
Die Wärmebehandlung bildet auf dem Nitrid eine sehr dünne Schicht 12 mit der chemischen Zusammensetzung
SixOyN* die die Widerstandsfähigkeit der
Siliziumnitridschicht 10 erhöht. Es wird angenommen. daß die Wärmebehandlung den Unterschied in der
Leitfähigkeit zwischen der Nitridschicht 10 und aer Oxydschicht 12 reduziert und dadurch wiederum die
Verschiebung der Schwellenspannung reduziert wird. Wie aus den nachfolgend gegebenen Daten jedoch
hervorgeht, ist das Verhalten von VVsehr komplex, und
es ist möglich, daß die Hypothese nur teilweise richtig ist.
F i g· IC zeigt das Halbleiterelement nach Ausbildung
des polykristallinen Siliziumgates 16. Die Herstellung erfolgt vorzugsweise im sog. »selbstausrichtenden
Verfahren«. Andere Herstellungsverfahren sind natürlieh
auch möglich.
Das Gate 16 wird im allgemeinen durch Niederschlagen von SiH4 in einem Träger aus H2-GaS bei etwa
8000C gebildet. Ein Niederschlag in zwei Schritten ist vorteilhaft, um eine glatte Elektrode zu erbalten. Im
ersten Schritt werden 500 Ä polykristallinen Siliziums durch Niederschlagen von SiH4 in einem N2-Träger bei
8000C gebildet. Anschließend weiden 6500Ä polykristallinen
Siliziums durch Niederschlagen von SiH4 in einem N2-Träger bei 8000C gebildet. Das Gate 16 wird
durch Dotierung mit einer P-leitenden Verunreinigung
leitend gemacht. Zur Erzielung eines Dotierungsniveaus von etwa 1019 Atomen/ccm im Gate 16 wird im
allgemeinen der BBr3-Diffusionsprozeß verwendet. Mit derselben Diffusion werden auch die Source- und
Drain-Bereiche 18 und 19 in F i g. ID dotiert.
Fig. ID zeigt einen vollständigen Feldeffekttransistor.
Eine dicke Oxydschicht 17 bedeckt das Gate 16. Die Oxydschicht 17 wird gebildet, indem zuerst das
polykristalline Silizium in trockenem O2 bei 10500C zur
Bildung einer 850 Ä dicken Schicht oxydiert wird. Anschließend wird zusätzliches SiO2 pyrolytisch niedergeschlagen
und die insgesamt 6500 λ dicke Oxydschicht
17 gebildet. Die P-leitenden Source- und Drain-Bereiche
18 und 19 werden gemeinsam durch eine BBn-Diffusion als Bereiche mit einem spezifischen Flächenwiderstand
von 15 Ohm pro Quadrat und einer Tiefe von etwa 1.25 um eebildet. Die Aluminiumelektroden 20 und 21
werden dann zur Bildung der Ohmschen Kontakte mit den Source- und Drain-Bereichen niedergeschlagen.
In dem oben beschriebenen Verfahren wird ein P-Kana!-FET hergestellt, der als Gate polykristallines
Silizium verwendet das stark mit einer P-leitenden Verunreinigung dotiert ist. Es wurde festgestellt daß die
Wärmebehandlung sehr wirksam die Schweller.spannung eines, solchen Transistors stabilisiert. Außerdem
wurde die Wärmebehandlung mit guten Ergebnissen bei
ίο N-Kanalelementen sowohl mit P-dotierten als auch mit
N-dotiertein polykristallinen Siliziumgates angewandt. Als Verunreinigung wird bei N-dotierten polykristallinen
Siliziumgates im allgemeinen Phosphor verwendet. Somit läßt sich das vorliegende Verfahren im breiten
Rahmen auf P-Kanal-, N-Kanal- und komplementäre Feldeffekttransistoren anwenden, die polykristallines
Silizium als Gate und ein aus Siliziumdioxyd und Siliziumniirid zusammengesetztes Gate-Dielektrikum
verwenden.
;o F i g. 2 zeigt schematisch einen FET unter Belastung.
In der Prüfschaltung betrug die Spannung am Gate des Elementes ±14 Volt bei Umgebungstemperaturen
von 150 bis 200 C. Source. Drain und das Substrat des FET sind geerdet. Source und Drain können aber auch
offen gelassen werden
Die durchschnittliche Schwellenspannungsverschiebung.
Δ Vy, in FETs wird bestimmt durch Messung von VV für eine Anzahl von fertigen Einheiten auf einem
Halbleiterplättchen, Vorspannen und Erhitzen derselben gemäß obiger Beschreibung und erneute Messung
von Win diesen Elementen, worauf Δ Werrechnet wird.
Es wurde festgestellt, daß das Erwärmen oder Erhitzen unter Sauerstoff für eine halbe oder ganze
Stunde bei 1050°C die beste Stabilität von VV erzeugt. Das Erwärmen erfolgt nach dem Niederschlagen der
Nitridschicht 10 in F i g. 1B und vor dem Niederschlagen
des polykristallinen Gates. Fig. 3 zeigt in einer Kurve
die Schwellenspannung als Funktion der Belastungszeit für eine Anzahl von Probeexemplaren. Man erkennt den
wesentlichen Einfluß, den das Erwärmen auf die Elemente hat.
Jeder Punkt in der unteren Kurve stellt die durchschnittliche Schwellenspannung VV für die Elemente
nach Belastung für eine gegebene Zeit dar. Die Schwellenspannung für Elemente, die mehr als
500 Stunden belastet wurden, ist praktisch dieselbe wie die für die Elemente vor ihrer Belastung, und die größte
Verschiebung ist kleiner als 500 mV. Für nichterwärmte Elemente nimmt die Schwellenspannung jedoch als
Funktion der Belastungszeit stark zu; db Verschiebung nach 500 Eielastungsstunden liegt über 1000 mV.
Die Tabelle in Fig. 7 zeigt den Einfluß der Sauerstoffwärmebehandlung bei verschiedenen Temperaturen
auf die Veränderung der Schwellenspannung
S5 Δ Yt für PKanaltransistoren, die nach dem in Fig. IA
bis ID gezeigten Verfahren hergestellt sind.
Jedes Plättchen, gekennzeichnet durch Losnummer und Plättchenzahl innerhalb des Loses, z. B. 30-3,
enthielt eine Anzahl von Transistoren, die bei einer
ho bestimmten Temperatur wahrend einer bestimmten Zeit in Sauerstoff erwärmt wurden. Anschließend wurde
eine Gate-Belastungsspannung, Vm:i..\sr. von +14VoIt
für bestimmte Transistoren und — 14VoIt für andere
Transistoren während entweder einer Stunde oder 16 Stunden, bei einer Umgebungstemperatur von 165C
angelegt.
So wurden z.B. die auf dem Plättchen Nr. 30-5 hergestellten Transistoren 0,5 Stunden lag bei 1050°C
unter Sauerstoff erwärmt. Nach Beendigung der Fabrikation wurden einige Transistoren 16 Stunden
lang bei 165°C einer Spannungsbelastung von +14 Volt und andere Transistoren auf demselben Plättchen unter
denselben Bedingungen einer Belastung von -14 Volt ausgesetzt. Für die mit der positiven Spannung
beaufschlagten Transistoren ergab sich eine durch schnittliche Änderung der Schwellenspannung AVT,
gemessen vor und nach der Belastung von insgesamt 39 mV. Für die mit einer negativen Spannung beauf- ι ο
schlagten Transistoren ergab sich eine durchschnittliche Änderung von 13 mV.
Die Daten in der F i g. 7 zeigen, daß Δ VV für eine
positive Belastungsspannung wesentlich größer ist als für eine negative, und zwar über dem gesamten
Temperaturbereich der Wärmebehandlung. Die Daten zeigen auch, daß Temperaturen zwischen 970 und
12000C eine gute durchschnittliche Stabilität für positive und negative Belastungsspannungen ergeben.
Nimmt man an, daß die W-Verschiebung für alle Belastungsbedingungen unter 15OmV liegen soll, dann
ist der Bereich zwischen 970 und 1200° C akzeptabel, wobei der Bereich zwischen 1050 und 1200°C für kleine
P-Kanal-FETs mit Abmessungen von 10 χ 50 μηι bevorzugt
wird. Wenn man vorhersagen könnte, daß die FETs im Betrieb nur durch negative Spannungen belastet
werden, würde auch eine Temperatur zwischen 800 und 900°C genügen. Eine solche Vorhersage ist jedoch im
allgemeinen nicht möglich, und daher ist dieser Bereich ungenügend.
Die Herstellungsverfahren für IGFETs eignen sich für
die Herstellung großer Kondensatoren mit dielektrischen und Metallschichten, die ähnlich hergestellt
werden wie die kleinen aktiven Elemente. Es gibt viele Gründe, die Stabilität großer Kondensatoren, die im
allgemeinen eine Fläche von 250 χ 250 μηι haben, zu
untersuchen. Einmal ist das größere Element leichter mit einer bestimmten Toleranz herzustellen. Zum
anderen lassen sich Parameter für das Element wegen der leichteren Kontaktierung durch verschiedene
Prüfgeräte, wie z. B. elektrische Prüfspitzen, leichter messen. Zum dritten erstrebt die moderne Schaltungstechnik die Integration von Leistungstreibern und
Abfrageverstärkung auf demselben Chip mit den kleineren FET-Elementen. Die hier beschriebenen
kleinen FET-EIemente können z. B. die Elemente einer
Großspeicheranordnung bilden. Zu dieser Anordnung gehören Eingabetreiber und Ausgabe-Abfrageverstärker
sowie die verschiedenen Lese-Schreib-Schaltungen, die auf demselben Chip hergestellt und wesentlich
größer sind als die Elemente der Speicheranordnung. Ein Kondensator mit einer Fläche von 250 χ 250 μπι
würde ζ. B. ungefähr in der Größe einem Leistungstreiber für eine Speicheranordnung entsprechen. Die
Auswirkungen der Wärmebehandlung auf große Kon densatoren müssen daher untersucht werden.
Mit dem in Fig.4 gezeigten SNOS-Kondensator
wurde die Stabilität der aus Nitrid und Oxyd zusammengesetzten Gate-Struktur genauer bestimmt.
Der Kondensator umfaßt ein Halbleitersubstrat 22, eine Siliziumdioxydschicht 24, eine Stliziumnitridschicht 26.
dotierte polykristalline Siliziumelektroden 28 und 29 und einen Aluminiumkontakt 30. Die Ähnlichkeit
zwischen den Strukturen der F i g. 4 und der F i g. IC ist offensichtlich. Wenn die Kondensatoren vor dem
Niederschlag der polykristallinen Siliziumelektroden erwärmt werden, wird eine sehr dünne Schicht 27 aus
Si,OvN, auf der Siliziumnitridschicht 26 ausgebildet Um
P-Kanalelemente zu simulieren, ist der Kondensator aui
einem N-leitenden Substrat aufgebaut, welches einer spezifischen Widerstand von 2 Ohm · cm und polykri
stalüne Siliziumelektroden aufweist, die mit Bor irr
BBr3-Diffusionsverfahren dotiert sind. Die Dicken der Oxydschicht 24 und der Nitridschicht 26 liegen im selber
Bereich wie bei dem oben besprochenen P-Kanaltransistor, d. h., das Oxyd liegt in der Dicke zwischen 200 unc
900 Ä und das Nitrid zwischen 100 und 350 A.
Die Flachbandspannungsverschiebung, AVFB, wurde
als Funktion der Belastungsspannung, der Temperatui und der Dauer für Elemente gemessen, die in Sauerstofl
nach dem Niederschlag der Siliziumnitridschicht 26 erwärmt wurden, und für Elemente, die nicht se
behandelt wurden. Die Flachbandspannungsverschie bung bei SNOS-Kondensatoren ist bekanntlich ein MaC
für dieselben dielektrischen Parameter wie die Schwellenspannungsverschicbung
bei SNOS-FETs.
Aus den Fig. 5A und 5B geht hervor, daß die Flachspannungsverschiebung Δ VFB wesentlich herabgesetzt
wird in Elementen, die in Sauerstoff bei 1050°C eine Stunde lang erwärmt wurden, gegenüber solcher
Elementen, die nicht behandelt wurden. Das gilt füi Elemente, die durch ein negatives Feld Eo.\ vor
2 χ 106 Volt pro cm bei 200°C, und für Elemente, die ir
einem positiven Feld derselben Größe und bei derselber Temperatur belastet werden. Mit zunehmender BeIa
stungszeit wird auch der Unterschied zwischen erwärm ten und nichterwärmten Elementen deutlicher. Wie be
den kleinen FETs wird die Belastungsspannung an die Silizium-Elektrode 28 oder 29 am Kondensator angelegi
und das Substrat geerdet. Die Belastungsspannung VbELAST wird so eingestellt, daß ein Feld über dem
Dielektrikum von 2 χ 105 Volt pro cm erzeugt wird. Aus der Gleichung (1) kann man die Belastungsspannung
errechnen:
l'
Q
BU.AST = E0x - f = !SS. .
ox " Ό ■
worin
In der Gleichung sind Kai und Kn die dielektrischen
Konstanten des Oxyds bzw. des Nitrids: Eo = 8,85xlO-'4F/cm, Cmat die bei Vorspannung der
Probe im Akkumulationsbereich gemessene Kapazität und A4, die Fläche der Elektrode.
Wichtig im Zusammenhang mit der Stabilität der Kondensatoren ist die Tatsache, daß das Erwärmen in
Sauerstoff bei 12000C nicht so wirksam ist wie bei 1050
oder HOO0C. Dieser Unterschied geht deutlich aus den
Kurven m den F i g. 6A und 6B hervor. Für positive und negative Belastungen ist die Flachbandspannungsverschiebung für bei 12000C behandelte Kondensatoren
wesentlich größer als für bei 10500C erwärmte Kondensatoren, insbesondere für positive Belastungsspannungen. Für negative Belastungsspannungen wird
mit zunehmender Belastungszeit die Differenz auch noch größer.
Obwohl die Kurven in Fig. 5 und 6 für dieselben
Variablen erstellt sind, Δ Vra gegen Belastungszeit ist
eine direkte Korrelation zwischen den beiden Kurven nicht möglich, weil die Messungen auf verschiedenen
Plattchendurchläufen vorgenommen wurden. Somit kann das Sauerstofferwärmen bei 10500C in den
Fig.5A und 5B nicht direkt in Beziehung «setzt
werden zu dem Sauerstofferwärmen bei 10500C
während einer Stunde in den F i g. 6A und 6B. Insgesamt sollen beide Kurven jedoch zeigen, daß eine Wärmebehandlung
unter Sauerstoffeinfluß bei 10500C bei Kondensatoren eine wesentliche Verbesserung der
Flachbandspannungsverschiebung gegenüber Elementen darstellt, die gar nicht oder bei 1200° C erwärmt sind.
Die Tabelle in Fig.8 zeigt den Einfluß des Sauerstofferwärmens auf die Vre-Stabilität von SNOS-Kondensatoren.
Die Kondensatoren der Tabelle in F i g. 8 wurden auf denselben Plättchen erzeugt wie die
in F i g. 7 angeführten Elemente. Die F i g. 8 ist somit mit den Werten der F i g. 7 gleichzusetzen, ausgenommen
die Messung von Vfb anstelle von Vt. Ein Erwärmen bei
12000C für eine halbe Stunde ist offensichtlich eher schädlich als nützlich. Das Erwärmen auf 1050 und
U50=C ist vorteilhaft für positive Belastungsspannungen.
In jedem Fall ist eine Wärmebehandlung zwischen 970 und 1050°C vorteilhaft, und das Erwärmen bei
1050°C für eine Stunde bietet ausgezeichnete Ergebnisse.
Das Erwärmen bei Temperaturen außerhalb dieses relativ engen Bereiches ist zu vermeiden.
Die oben zitierten Ergebnisse sind auf P-Kanalelemente,
d. h. auf Elemente beschränkt, in denen die Gates mit P-leitendem Material dotiert sind. Die Anwendung
der Erfindung ist darauf jedoch nicht beschränkt. Ein N-Kanal-FET mit denselben Abmessungen wie der
P-Kanal-FET, der in Fig. ID gezeigt ist. wurde eine
Stunde lang auf 10500C in trockenem Sauerstoff erwärmt. Die Messungen zeigten eine geringere
Abweichung der Schwellenspannung als bei nichtbehandelten N-Kanalelementen.
Insgesamt wurde die Stabilität der Schwellenspannung
bei kleinen und großen FETs mit Siliziumgate dadurch stark verbessert, daß man das Siliziumnitrid im
vorgeschriebenen Temperaturbereich unter Sauerstoffeinfluß erhitzt. Die Wärmebehandlung verändert die
Größe der Schwellenspannung um durchschnittlich 75 bis 150 mV, andere Parameter des Elementes werden
dadurch jedoch nicht wesentlich beeinflußt.
Hierzu .1 Blatt Zeichnungen
109 507/244
Claims (7)
1. Verfahren zum Stabilisieren der Schwellenspannung von Silizium-Gate-Feldeffekttransistoren mit
aus Oxyd/Nitrid-Isolierschichten zusammengesetzten Gate-Dielektrika mittels einer Wärmebehandlung,
dadurch gekennzeichnet, daß nach dem Aufbringen der Schichten aus Siliziumoxyd und
Siliziumnitrid auf ein Siliziumsubstrat und vor dem Ausbilden des Silizium-Gates auf der Süraumnitridschicht
in trockener Sauerstoffatmosphäre bei einer Temperatur von 970 bis 11500C erwärmt wird.
2. Verfahren nach Anspruch 1, dadurch gekennzeichnet,
daß bei einer Temperatur von 10500C erwärmt wird.
3. Verfahren nach Anspruch 1 oder 2, dadurch gekennzeichnet, daß die Erwärmung während
höchstens einer Stunde vorgenommen wird.
4. Anwendung des Verfahrens nach einem der Ansprüche 1 bis 3 bei einem P-Kanal-Feldeffekttransistor
mit P-dotiertem Silizium-Gate.
5. Anwendung des Verfahrens nach einem der Ansprüche 1 bis 3 bei einem Feldeffekttransistor, der
eine 300—350 λ dicke Nitridschicht und eine
200—900 A dicke Oxydschicht aufweist.
6. Anwendung des Verfahrens nach einem der Ansprüche 1 bis 3 bei einem Feldeffekttransistor, bei
dem sowohl die Nitridschicht als auch die Oxydschicht je 300 Ä dick ist.
7. Anwendung des Verfahrens nach einem der Ansprüche 1 bis 3 bei SNOS (silicon-nitride-oxidesemiconductor)-Kondensatoren.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US30860872A | 1972-11-21 | 1972-11-21 | |
US30860872 | 1972-11-21 |
Publications (3)
Publication Number | Publication Date |
---|---|
DE2355605A1 DE2355605A1 (de) | 1974-06-12 |
DE2355605B2 true DE2355605B2 (de) | 1977-02-17 |
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Family
ID=
Also Published As
Publication number | Publication date |
---|---|
FR2207359B1 (de) | 1977-08-12 |
US3793090A (en) | 1974-02-19 |
CH555597A (de) | 1974-10-31 |
JPS4984180A (de) | 1974-08-13 |
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IT998626B (it) | 1976-02-20 |
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Legal Events
Date | Code | Title | Description |
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C3 | Grant after two publication steps (3rd publication) | ||
E77 | Valid patent as to the heymanns-index 1977 | ||
8339 | Ceased/non-payment of the annual fee |