DE3008919A1 - Schaltanordnung mit veraenderlicher verzoegerung - Google Patents
Schaltanordnung mit veraenderlicher verzoegerungInfo
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- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
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- H03K5/13—Arrangements having a single output and transforming input signals into pulses delivered at desired time intervals
- H03K5/14—Arrangements having a single output and transforming input signals into pulses delivered at desired time intervals by the use of delay lines
Description
Dipl.-lng. A. Wasmeier
Dipl.-lng. H. Graf
Zugelassen beim Europäischen Patentamt · Professionat Representatives before the European Patent Office
Patentanwälte Postfach 382 8400 Regensburg 1
An das
Deutsche Patentamt
SDDQ München 2
D-8400 REGENSBURG QREFLINGER STRASSE Telefon (0941)547 53
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I/p 10.174
Da?·
6. März
198D Id/Ja
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Titel:
Priorität:
Erfinder:
International Computers Limited
ICL House, Putney, London SÜI15 1SId, England
Schaltanordnung mit veränderlicher Verzögerung Großbritannien Nr. 79GSB26 vom 13. März 1979
Colin Mayor, Ingenieur
70 Higher Lomax Lane, HeyuoDd, Lanes, 0L10
England
030039/0688
Schaltanordnung mit veränderlicher Verzögerung
Die Erfindung bezieht sich auf Schaltanordnungen mit veränderlicher
Verzögerung.
Ea sind verachiedene Verfahren zur Erzielung von Verzögerungen bekannt.
Beispielsweise können Verzögerungen durch kapazitive ader induktive Stromkreise, oder aber durch Ultraschall-Verzögerungsleitungen
erzielt uierden. Heine dieser Methoden ist jedoch zur Erzeugung
sehr geringer Verz-ögerungen geeignet., die z.B. in der
Größenordnung von einigen Nanosekunden liegen..
Aufgabe der Erfindung ist es somit, eine Schaltanordnung zu schaff
mit deren Hilfe es möglich ist, sehr geringe Verzögerungen in dei
Größenordnung von einigen Nanosekunden zu erreichen.
Diese Aufgabe ujird mit einer Schaltanordnung erzielt, die gekennzeichnet
ist durch eine Vielzahl von Verzögerungsvorrichtungen, deren jede Eingangs-und Ausgangsverbindungen und eine Eigenverzögerungsperiode
besitzt, und die so in Reihe geschaltet sind, daß ein der Eingangsverbindung der ersten Verzögerungsvorrichtung der
Reihe aufgegebenes Signal durch jede Verzögerungsvorrichtung in dei
Reihe nacheinander in Kaskade geschaltet und fortschreitend durch die Eigenverzögerungen verzögertuird, einen Ausgangsanschluß der
Schaltung, eine Auswahlschaltung zum selektiven Verbinden der
Ausgangsverbindung einer beliebigen ausgewählten Verzögerungsvorrichtung zum Ausgangsanschluß und eine Vorrichtung, die eine kallek
tive Einstellung der Eigenverzögerungen der Verzögerungsvorrichtungen steuert.
Weitere Merkmale sind Gegenstand der Unteransprüche.
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Die Erfindung ist in der Lage, Verzögerungen in der Größenordnung der Eigenverzögerungsdauern der Verzögerungsvorrichtungen zu erzeugen.
Wenn die Verzögerungsvorrichtungen logische Vorrichtungen sind, lassen sich Verzögerungen in der Größenordnung van einer
IManosekunde pro Gatter erzielen. Ferner ist die Verzögerung auf
einfache Weise mit Hilfe der Auswählschaltung veränderbar.
Bei einer bevorzugten Ausführungsform der Erfindung, bei der
die Verzögerungsvorrichtungen logische Gatter sind, wird eine Speisequelle veränderlicher Spannung an wenigstens eines der
logischen Gatter gelegt und so ausgebildet, daß die Schwellwertspannung verändert wird, bei der das (oder jedes) Gatter wirksam
wird, wodurch eine Einstellung der ^igenverzögerung des (oder jedes
solchen) Gatters möglich ist. Dies stellt ein Mittel dar, um die Eigenverzögerungen der Gatter auf einen gewünschten Wert abzugleichen.
Nachstehend wird eine bevorzugte Ausführungsform der Erfindung in
Verbindung mit der Zeichnung erläutert, die ein Schaltbild einer Verzögerungsschaltung nach der Erfindung zeigt.
Die Verzögerungsschaltung weist eine Kette von zehn Verzögerungsvorrichtungsn
in Form logischer Gatter G1 - G10 auf, die in Serie geschaltet sind. Der Eingang des ersten Gatters in die Serie ist
an einen Eingangsanschluß 2 gelegt. Somit wird ein Signal einer Form, die für die Art der verwendeten Verzögerungsvorrichtung geeignet
ist und in den Eingangsanschluß 2 eingeführt wird, in Kaskade durch die Ketten von Gattern geschaltet und fortschreitend
beim Passieren eines jeden Gatters verzögert.
Bei dieser Ausführungsform der Erfindung sind die logischen Gatter
G1 - G10 integrierte logische Schaltelemente der Firma Fairchild F 100K, der Type 100102. Dieses sind emittergekoppelte logische
Gatter, deren jedes eine Eigenverzögerung von etwa 900 Picosekunden besitzt.
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Die Ausgänge aus den zehn Gattern sind mit entsprechenden Eingänger
eines 16 - zu 1 - Multiplexers 3 verbunden, und die sechs unbenutzten Eingänge des Multiplexers sind an IMullpotential gelegt.
Der Multiplexer 3 wählt einen dieser Eingänge entsprechend dem Binärcode aus, der an vier Steueranschlüsse k gelegt ist,
wobei der ausgewählte Eingang einem Ausgangsanschluß 5 zugeführt wird.
Bei dieser Ausführungsform ist der Multiplexer ein Fairchild-Gerät
der Type 1G0164.
Zwischen den Ausgang der entsprechenden Gatter G1 - G10 und Erdpotential
sind Abgleichkondensataren C1 - C1D geschaltet. Die WertE
dieser Kondensatoren sind so gewählt (üblicherweise in der Größenordnung von D - 1D Picofarads), daß die Verzögerungen aller logischen
Gatter gleich groß werden, wodurch jede Unregelmäßigkeit in den Eigenverzögerungen kompensiert wird.
Die Ausgänge der Gatter G1 - G1D sind mit entsprechenden Emitter-Lastwiderständen
R1 - R10 verbunden, deren jeder einen üJert von
68 Ohm hat. Normalerweise sollen diese Widerstände mit einer
Festspannungsquelle von 2 V verbunden sein. Bei der vorliegenden Ausführungsform der Erfindung sind die Widerstände R1 - R1D
jedoch an eine Speisequelle 6 mit veränderlicher Spannung gelegt, die einen Spannungaausgang erzeugt, der im Bereich von 1,8 - 1,9 V
veränderlich ist. Die Änderung dieser Spannung verändert den Schwellwertpegel, bei welchem jedes der Gatter G1 - G1G wirksam
wird, und verändert somit die Eigenverz-.ögerungen. der Gatter. Dies ermöglicht, daß die Verzögerungen aller Gatter miteinander
abgeglichen werden, so daß sie alle auf einen gewünschten UJert (z.B. 1 IManosekunde) eingestellt werden können. Wenn die Verzögen,
auf diese Weise geeignet abgeglichen wird, ist sie in d er Lage, exakte Verzögerungen im Bereich von 1-10 Nanosekunden zu erzeugen,
je nach dem Binärcode, der den Steueranschlüssen k aufgegeben wird
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Claims (1)
- Patentansprüche<1y Schaltanordnung mit veränderlicher Verzögerung, gekennzeichnet durch eine Vielzahl van Verzögerungsvorrichtungen (G1 - G1O), deren jede Eingangs- und Ausgangsverbindungen und eine Eigenverzögerungspericde besitzt, und die so in Reihe geschaltet sind, daß ein der Eingangsverbindung (2) der ersten Verzögerungsvorrichtung (GD der Reihe aufgegebenes Signal durch jede Verzögerungsvorrichtung in der Reihe nacheinander in Kaskade geschaltet und fortschreitend durch die Eigenverzögerungen verzögert wird, einen Ausgangsanschluß (5) der Schaltung, eine Auswahlschaltung (3) zum selektiven Verbinden der Ausgangsverbindung einer beliebigen ausgeujählten Verzögerungsvorrichtung (G1 - G10) zum Ausgangsanschluß (5),und eine Vorrichtung (6), die eine kollektive Einstellung der Eigenverzögerungen der Verzögerungsvorrichtungen steuert.2. Schaltanordnung nach Anspruch 1, dadurch gekennzeichnet, daß die Einstellung der Eigenverzögerung eine Vorrichtung (C1 - C1O) zum individuellen Trimmen oder Einstellen der Verzögerungsperioden der Verzögerungsvorrichtungen (61 - G1D) aufweist.3. Schaltanordnung nach Anspruch 1 oder 2, dadurch gekennzeichnet, daß die Einstellung der Eigenverzögerung eine Speisequelle (6) veränderlicher Spannung aufweist, die mit jeder der Verzögerungavorrichtungen (G1 - G1O) so verbunden ist, daß die Schwellwertspannung verändert werden kann, bei der jede solche Verzögerungen vorrichtung wirksam wird, wodurch eine Einstellung der Eigenverzögerungsvorrichtung einer jeden solchen Verzögerung möglich ist.k. Schaltanordnung nach Anspruch 1, 2 oder 3, dadurch gekennzeichnet, daß für jede Verzögerungsvorrichtung (G1 - G1D) ein Lastwiderstand (R1 - R1O) in den Verbindungsleitungen zum Aufgeben der veränderlichen Spannung vorgesehen ist.030039/0 6 885. Schaltanordnung nach Anspruch 1, 2 oder 3, k, dadurch gekennzeichnet, daß ein Abgleichkondensator (C1 - C10) für jede der
Uerzögerungsvorrichtungen vorgesehen ist, und daß jeder Abgleichkondensator (C1 - C10) zwischen die ε ntsprechenden Ausgangsverbindungen der Verzögerungsvorrichtungen und Erdpatential eingeschaltet ist, wobei jede verzögerungsvorrichtung individuell einstellbar ist.S. Schaltanordnung nach einem der Ansprüche 1 bis 5, dadurch gekenn zeichnet, daß jede verzögerungsvorrichtung (G1 - G1Q) durch ein logisches Batter dargestellt ist.7, Schaltanordnung nach einem der Ansprüche 1 bis 6, dadurchgekennzeichnet, daß die Auswahlvorrichtung (3) einen MultiplexE aufweist, dessen Ausgang mit dem Ausgangsanschluß (5) der Schalt anordnung verbunden ist, wobei erste Eingänge so geschaltet sine daß sie einen Ausgang aus dem Uerzögerungsvorrichtungen aufneh men, und zweite Eingänge (if) so geschaltet sind, daß sie Steuersignale zur Steuerung der Auswahl des an den Multiplexerausgan zu gebenden Einganges aufnehmen.030039/0688
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